[VHDL编程] fpq128

说明：自己编的一个分频器的程序模版 虽然原理很简单，经过多次实践很实用 被多次用在其它的程序中-own series of the dividers of a procedure template Although very simple principle, after repeated practice by many very practical use in other proceedings, and,
<安德森> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] 分频器FENPIN1

说明：EDA中常用模块VHDL程序，不同时基的计数器由同一个外部是中输入时必备的分频函数。分频器FENPIN1/2/3(50分频=1HZ，25分频=2HZ，10分频=5HZ。稍微改变程序即可实现)-EDA VHDL modules commonly used procedure, the time- with a counter by the external input is required when the sub-frequency functions. Frequency Divider F
<李培> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] 减法计数器

说明：EDA常用计数函数VHDL程序设计，减法计数器：可预置数：-common counting function EDA VHDL programming, subtraction counter : Preset :
<李培> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] PLW

说明：电子密码锁的vhdl编程实现，不知以前有没有人做过的。-electronic locks VHDL programming, I wonder if the past is not done.
<王卫> 在 2025-06-07 上传 | 大小：3kb | 下载：1

[VHDL编程] and_or

说明：veilog 代码 用户可以直接调用，作为底层模块。同时已经编译成功，可以作为基本单元库。-veilog code user can derict use it for the base mode.
<宋昆仑> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] backward

说明：verilog 代码. 经验证成功,可以作为标准单元库,为FPGA设计者使用.-Verilog code. Certified success, as a standard cell library for the use of FPGA designers.
<宋昆仑> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] 4x4的数据选择器

说明：用vhdl的4x4的数据选择器，在maxplusII下编译、仿真通过。是构成大型数字电路的重要部件。适合vhdl初学者分析学习。-4x4 with the VHDL data selectors, under the maxplusII compiler, simulation through. Yes constitute large-scale digital circuits important components. VHDL Analysis for beginners to lear
<roya> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] pci 的vhdl 源代码

说明：pci 的vhdl 源代码-The source code of PCI VHDL.
<陈旭> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] 65filter

说明：65位FIR数字滤波器的设计~~其中有通过仿真得出得数据 ~可以通过数据输入完成滤波实验~对数字滤波器得整个算法进行了分析包括输入分组相加 然后相乘得过程-65 FIR digital filter design ~ ~ with simulation data to come in through the importation of data from experiments completed filtering of the digital filter in the whole alg
<凌燕> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] FSKDFSK

说明：fsk调制与解调，此程序经过验证，可以运用，通讯方面的同学可以用-FSK modulation and demodulation, this procedure has been verified and can use communications students can use
<we> 在 2025-06-07 上传 | 大小：3kb | 下载：1

[VHDL编程] PCI总线仲裁参考设计，Quicklogic提供

说明：PCI总线仲裁参考设计，Quicklogic提供的verilog代码-PCI bus arbitration reference design, pioneered the Verilog code
<陈旭> 在 2025-06-07 上传 | 大小：3kb | 下载：0

[VHDL编程] Multi_SI

说明：用verilog实现的乘法器，可以综合，经过验证。-Implementation multiplication with verilog.
<yangyang> 在 2025-06-07 上传 | 大小：3kb | 下载：0