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[VHDL编程] control_interface
说明:SDRAM控制器Verilog员代码,控制接口模块,完成和顶层模块的控制命令的传递-SDRAM controller member Verilog code control interface module, Top module and complete the transfer of control orders<陈建勇> 在 2025-07-01 上传 | 大小:3kb | 下载:0
[VHDL编程] verilogclock
说明:如果不考虑占空比,直接利用计数器来进行分频,则占空比会发生变化。下面程序实现1:1的三分频。-if not duty cycle directly counter to the use of sub-frequency, duty cycle will change. Below a program : a third of the frequency.<> 在 2025-07-01 上传 | 大小:3kb | 下载:0
[VHDL编程] sobel
说明:这是本人自己编写的可用于256*256大小的图像进行sobel边缘检测的vhd文件,可在QuartusII或MaxplisII下综合和仿真,并在FPGA上测试过。可以进行修改支持其他大小图像的sobel边缘检测,同时还可以实现其它的图像模块化处理算法,例如高斯滤波,平滑等。-this is my own preparation for the 256* 256 size of the image segmentation Edge Detection vhd document in the ne<刘洋> 在 2025-07-01 上传 | 大小:3kb | 下载:2
[VHDL编程] Verilogdianzirili
说明:基于Verilog 的电子日历与电子时钟程序,可以进行调日期、星期、时间的分钟与小时,通过几种模式来显示日历与时间。-Verilog-based electronic calendar and e-clock procedures, can be adjusted date, week, time of minutes and hours, through several models to display a calendar and time.<iqpler> 在 2025-07-01 上传 | 大小:3kb | 下载:0
[VHDL编程] VHDL_to_UART
说明:用VHDL编写的串口通讯程序,包括几个不同的程序例子,也可以用verilog进行改写。<汪毅> 在 2025-07-01 上传 | 大小:3kb | 下载:0
[VHDL编程] 16Point-radix4-FFT
说明:本文提出一個根值4 蝴蝶元素使用(m, n) - 櫃臺減少硬體複雜, 延遲時間, 和電力消費被介入在使用常規加法器。並且一臺修改過的換向器為FFT 算法被描述與用管道運輸的實施一起為連續輸入資料減少資料記憶要求。-This paper presents a root element of the use of 4 Butterfly (m, n)- the counter to reduce the hardware complexity, latency, and power consumpt<旻倫> 在 2025-07-01 上传 | 大小:3kb | 下载:0