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[VHDL编程ssram-and-tesebench

说明:实现一个256x8的同步静态存储器SSRAM,用硬件描述语言Verilog写的,同时谢了测试程序-it realized a 256x8 SSRAM,writen by Hardware descr iption language Verilog ,and include the testbench.
<李柏祥> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程Four-multipliers-with-VHDL-

说明:用VHDL实现四位乘法器,不直接用乘法实现。该代码思路清晰,希望可以帮助到大家!-Four multipliers with VHDL implementation, not directly with the multiplication implementation. The code is clear thinking, I hope to help to you!
<recochun> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程SP_RAM_16x8_TB_solution

说明:SP_RAM_16x8_TB_solution SRam 16x8 test bench solution. useful for verification.
<gopi> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程Parking_plaza

说明:Parking_plaza Parking_plaza Parking_plaza-Parking_plaza Parking_plaza Parking_plaza Parking_plaza
<basit> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程counter

说明:一个模10计数器的vhdl程序,希望对大家有帮助-A module 10 counter vhdl program, we want to help
<陈政波> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程ram

说明:一个简单的ram,自己写的。希望对大家有用-A simple ram, write your own. Hope to useful
<ly> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程ANTIREBOTE

说明:Codigo antirebote para utilizar en tu proyecto de digitales
<jacobo> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程counter_interleaver

说明:It is verilog based implementation of interleaver and counter for 0,15,3,7,8,4,2,14
<urvish> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程isp-rs232

说明:用RS232接口传输的数据到计算机终端机上 -RS232 interface, with data transmitted to a computer terminal
<Duan> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程clk

说明:这是一个数字秒表的设计。几时周期为0.01s-1h。带有计数器的清零端,还有一个秒表的计时起止控制开关,最后计时信息显示在数码管上。-This is a digital stopwatch design. When a period of 0.01s-1h. Cleared with the end of the counter, and a stopwatch start and end time-control switch, th
<linpy> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程dcf089f8-85a5-44b9-98d9-e667ba564784

说明:除法器能够做除法运算能够做除法运算 除法器能够做除法运算能够做除法运算-Divider can do can do division division
<zz> 在 2025-05-30 上传 | 大小:1kb | 下载:0

[VHDL编程fsm_moore_3_always

说明:使用3個always (三段式)來實現Moore FSM。 -Moore FSM
<李蒙> 在 2025-05-30 上传 | 大小:1kb | 下载:0
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