[VHDL编程] Rader17.v

说明：DFT Implementation with Rader Algorithm. 17 points DFT verilog implementation design.
<zi> 在 2025-06-18 上传 | 大小：2kb | 下载：0

[VHDL编程] VHDL-for-Datapath

说明：MIPS CPU with Mulicycle Datapath. This is a custom RISC processor implemented to achieve the function of "lw, sw, add, sub, and, or, beq, j" Mem.vhd - memory buffer.vhd - buffer ALUcon.vhd - Alu controller pc.vhd - program counter REG - reg
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[VHDL编程] CPU-32

说明：A 32 bit cpu implementation designed on verilog with test bench.
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[VHDL编程] ETA-1

说明：error tolerant addercodings in vhdl
<rajkumar> 在 2025-06-18 上传 | 大小：24kb | 下载：0

[VHDL编程] Microprocessor-design-P-VHDL

说明：Microprocessor design with VHDL
<Zizaum> 在 2025-06-18 上传 | 大小：4.44mb | 下载：0

[VHDL编程] VHDL-Programming-by-Example

说明：VHDL programming by example
<Zizaum> 在 2025-06-18 上传 | 大小：1.7mb | 下载：0

[VHDL编程] ASIC-and-FPGA-Verification---A-Guide-To-Component

说明：ASIC and FPGA Verification - A Guide To Component Modeling
<Zizaum> 在 2025-06-18 上传 | 大小：1.35mb | 下载：0

[VHDL编程] 3.VGA

说明：FPGA驱动VGA接口显示彩虹条的实验，代码VHDL跟Verilog HDL的都有-FPGA drive VGA interface to display
<liwenwen> 在 2025-06-18 上传 | 大小：738kb | 下载：0

[VHDL编程] External_LCD

说明：datalogger display cource code
<a> 在 2025-06-18 上传 | 大小：21kb | 下载：0

[VHDL编程] dds

说明：xilinx公司的ddsip核的规格和使用说明，能实现大多数波形的产生。-dds ip core of xilinx company.
<lucun> 在 2025-06-18 上传 | 大小：1.59mb | 下载：0

[VHDL编程] 16QAM

说明：基于FPGA 16QAM解调verilog代码，-16QAMdemoluator veriliog
<yangwei> 在 2025-06-18 上传 | 大小：738kb | 下载：1

[VHDL编程] 7

说明：introdction to mav using Filed Programmable Gate Array(FPGA)
<vinay> 在 2025-06-18 上传 | 大小：196kb | 下载：0