[VHDL编程] tlc549

说明：数字电压表的实现，VHDL语言实现，AD采用TLC549，通过学习，了解AD采集过程-The realization of digital voltage meter, VHDL language, AD using TLC549, by learning to understand the acquisition process AD
<LX> 在 2025-06-18 上传 | 大小：2kb | 下载：0

[VHDL编程] dac

说明：0～5伏可调数字电压源，以5伏为基准电压，数码管显示当前电压值，使用VHDL语言实现，程序都加了注释，方便阅读。 -0 ~ 5 V digital voltage source adjustable to 5 V for the voltage reference, digital tube displays the current voltage value, the use of VHDL language, the program notes are added to facilita
<LX> 在 2025-06-18 上传 | 大小：1kb | 下载：0

[VHDL编程] eff1

说明：利用Verilog实现的跑马灯，从护栏管的一端循环到另一端。其他类似此类的循环语句基本一样。-Marquee achieved using Verilog, from one end of tube to the other end of the cycle. Other similar expressions of such basic, like the cycle.
<Chao> 在 2025-06-18 上传 | 大小：1kb | 下载：0

[VHDL编程] FPQ

说明：基于FPGA的数控分频器，可以吧一个时钟信号分成不同频率的时钟信号。-FPGA-based digital frequency divider, a clock signal can now be divided into different frequency clock signals.
<静> 在 2025-06-18 上传 | 大小：3kb | 下载：0

[VHDL编程] sin

说明：基于FPGA的正弦波发生器，可以产生不同频率的正弦波。-FPGA-based sine wave generator, can produce different frequency sine wave.
<静> 在 2025-06-18 上传 | 大小：595kb | 下载：0

[VHDL编程] Shuma

说明：完整的电子钟程序，包含报时、定时、闹表的功能，其中包含了二十四进制，60进制计数器的设计，和顶层文件-Complete procedures for the electronic bell, including the time, from time to time, to make the function table, which contains 24 hexadecimal, 60 hexadecimal counter design, and top-level document
<李坤鹏> 在 2025-06-18 上传 | 大小：887kb | 下载：0

[VHDL编程] rloc

说明：RLOC 属性在vhdl code中的直接描述。xilinx的范例文件-Example files for the applicantion of RLOC in Xilinx device.
<xiang> 在 2025-06-18 上传 | 大小：5kb | 下载：0

[VHDL编程] Adder_Verilog

说明：对于Verilog初学者非常实用的代码，帮助了解许多常用的加法器-Very useful for beginners Verilog code to help understand the many commonly used adder
<周士威> 在 2025-06-18 上传 | 大小：2kb | 下载：0

[VHDL编程] RS204_188

说明：可以省去开发者编写译码器的时间，高效的译码器给开发者带来便利-Save developers time to prepare decoder, efficient decoder to facilitate developer
<周士威> 在 2025-06-18 上传 | 大小：14kb | 下载：0

[VHDL编程] Multiple

说明：高效的乘法器设计，既节约面积，又提高性能，同时减少开发周期-Efficient multiplier design, both to save space and improve performance while reducing the development cycle
<周士威> 在 2025-06-18 上传 | 大小：2kb | 下载：0

[VHDL编程] VHDL-FPGA-xilinx-altera-frily

说明：VHDL的经典经验。相当的不错，一个多年开发FPGA的工程师自己的记录，适用于ALTERA,XILINX,LATTICE等FPGA的开发。希望对大家有用。-VHDL-xilinx-fpga-altera VHDL-xilinx-fpga-altera VHDL-xilinx-fpga-altera VHDL-xilinx-fpga-altera VHDL-xilinx-fpga-altera
<何思涵> 在 2025-06-18 上传 | 大小：3.73mb | 下载：1

[VHDL编程] GF_Multipe

说明：加德罗域乘法器提供了一种新型的乘法器设计模式-Multiplier加德罗domain to provide a new design of the multiplier model
<周士威> 在 2025-06-18 上传 | 大小：2kb | 下载：0