[VHDL编程] ram

说明：RAM， Random-access memory，Verilog code-RAM, Random-access memory, Verilog code
<leigh lee> 在 2025-06-09 上传 | 大小：14kb | 下载：0

[VHDL编程] rom

说明： Read-only memory,Verilog code
<leigh lee> 在 2025-06-09 上传 | 大小：8kb | 下载：0

[VHDL编程] 128×16ram

说明：VHDL程序设计的RAM存储器，双端口，128×16比特-VHDL programming RAM memory, dual-port, 128 × 16 bits
<petri> 在 2025-06-09 上传 | 大小：1kb | 下载：0

[VHDL编程] add_1p

说明：2级流水线实现的8位全加器的VHDL代码，适用于altera系列的FPGA/CPLD-Realize two lines of eight full adder of the VHDL code, applicable to altera series of FPGA/CPLD
<wgx> 在 2025-06-09 上传 | 大小：1kb | 下载：0

[VHDL编程] add_2p

说明：2级流水线，使用4元件实现的22位全加器的VHDL语言实现，适用于altera的FPGA-2 lines, use the 4 components realize the full adder 22 of the VHDL language, applicable to altera the FPGA
<wgx> 在 2025-06-09 上传 | 大小：1kb | 下载：0

[VHDL编程] add_3p

说明：3级流水线，含4元件的22位全加器的VHDL语言实现，适用于altera系列的FPGA-3-stage pipeline, with 4 components of 22 full adder realize the VHDL language, applicable to altera Series FPGA
<wgx> 在 2025-06-09 上传 | 大小：2kb | 下载：0

[VHDL编程] add_ff8

说明：利用触发器实现的，8位半加器的VHDL语言实现，适用于altera系列FPGA-Realize the use of triggers, and 8-bit half adder of the VHDL language, applicable to altera Series FPGA
<wgx> 在 2025-06-09 上传 | 大小：1kb | 下载：0

[VHDL编程] add_ff8cin

说明：触发器实现的，8位全加器的VHDL语言实现，适用于altera系列的FPGA-Flip-flop to achieve, eight full adder realize the VHDL language, applicable to altera series FPGA
<wgx> 在 2025-06-09 上传 | 大小：1kb | 下载：0

[VHDL编程] VideoGenerator

说明：用lattice XP3 demo板设计的VGA信号发生器，编译平台ispLEVER6-With lattice XP3 demo board design VGA signal generator, the compiler platform ispLEVER6
<朱强光> 在 2025-06-09 上传 | 大小：287kb | 下载：0

[VHDL编程] ip_fft128

说明：128点fft的IP核vhdl源代码，另有其控制代码。-128 point fft s IP core VHDL source code, while its control code.
<戈立军> 在 2025-06-09 上传 | 大小：7kb | 下载：0

[VHDL编程] gal

说明：用于编可编辑芯片用,如gal16v18芯片等,有几个文件, 内有说明等!-Series can be used to edit the chips used, such as chips gal16v18, there are several documents, there are descr iptions!
<mabaohua> 在 2025-06-09 上传 | 大小：35kb | 下载：0

[VHDL编程] vga_lcd

说明：这个是VGA的核是NOIS开发时使用的IP CORES 在FPGA的开发中使用的比较多-This is a VGA Nois nuclear development is the use of IP CORES in the FPGA used in the development of more
<luojie> 在 2025-06-09 上传 | 大小：591kb | 下载：0