文件名称:svc_timer33ms
- 所属分类：
- VHDL编程
- 资源属性：
- [VHDL] [源码]
- 上传时间：
- 2012-11-26
- 文件大小：
- 746kb
- 下载次数：
- 0次
- 提 供 者：
- huangy*******
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介绍说明－－下载内容均来自于网络，请自行研究使用
Verilog 下脉冲发生器的源代码，可用于模拟三相交流电过零点，主要用于调试一些类似SVC（无功补偿）控制器的一些算法-Pulse generator under the Verilog source code, can be used to simulate three-phase alternating current zero-crossing point, mainly for debugging similar SVC (reactive power compensation) controller of a number of algorithms相关搜索： 脉冲
VHDL
Verilog
Generator
VHDL
code
for
Pulse
Generator
VHDL
Verilog
Generator
VHDL
code
for
Pulse
Generator
(系统自动生成,下载前可以参看下载内容)
下载文件列表
svc_timer33ms
.............\db
.............\..\add_sub_6sh.tdf
.............\..\add_sub_ash.tdf
.............\..\svc_timer.eco.cdb
.............\..\svc_timer.sld_design_entry.sci
.............\..\timer.asm.qmsg
.............\..\timer.asm_labs.ddb
.............\..\timer.cbx.xml
.............\..\timer.cmp.cdb
.............\..\timer.cmp.hdb
.............\..\timer.cmp.kpt
.............\..\timer.cmp.logdb
.............\..\timer.cmp.rdb
.............\..\timer.cmp.tdb
.............\..\timer.cmp0.ddb
.............\..\timer.dbp
.............\..\timer.db_info
.............\..\timer.eco.cdb
.............\..\timer.fit.qmsg
.............\..\timer.fnsim.hdb
.............\..\timer.fnsim.qmsg
.............\..\timer.hier_info
.............\..\timer.hif
.............\..\timer.map.cdb
.............\..\timer.map.hdb
.............\..\timer.map.logdb
.............\..\timer.map.qmsg
.............\..\timer.pre_map.cdb
.............\..\timer.pre_map.hdb
.............\..\timer.psp
.............\..\timer.rtlv.hdb
.............\..\timer.rtlv_sg.cdb
.............\..\timer.rtlv_sg_swap.cdb
.............\..\timer.sgdiff.cdb
.............\..\timer.sgdiff.hdb
.............\..\timer.signalprobe.cdb
.............\..\timer.sim.hdb
.............\..\timer.sim.qmsg
.............\..\timer.sld_design_entry.sci
.............\..\timer.sld_design_entry_dsc.sci
.............\..\timer.syn_hier_info
.............\..\timer.tan.qmsg
.............\..\wed.zsf
.............\LIB.DLS
.............\read me.txt
.............\svc_timer.qpf
.............\svc_timer.qws
.............\time.acf
.............\time.hif
.............\timer.acf
.............\timer.asm.rpt
.............\timer.cdf
.............\timer.done
.............\timer.dpf
.............\timer.fit
.............\timer.fit.rpt
.............\timer.fit.smsg
.............\timer.fit.summary
.............\timer.flow.rpt
.............\timer.hex
.............\timer.hif
.............\timer.jam
.............\timer.jbc
.............\timer.map.rpt
.............\timer.map.summary
.............\timer.mmf
.............\timer.ndb
.............\timer.pin
.............\timer.pof
.............\timer.qpf
.............\timer.qsf
.............\timer.qws
.............\timer.rpt
.............\timer.scf
.............\timer.snf
.............\timer.sof
.............\timer.tan.rpt
.............\timer.tan.summary
.............\timer.ttf
.............\timer.v
.............\timer.v.bak
.............\U0127638.DLS
.............\管脚分配说明.txt
.............\db
.............\..\add_sub_6sh.tdf
.............\..\add_sub_ash.tdf
.............\..\svc_timer.eco.cdb
.............\..\svc_timer.sld_design_entry.sci
.............\..\timer.asm.qmsg
.............\..\timer.asm_labs.ddb
.............\..\timer.cbx.xml
.............\..\timer.cmp.cdb
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.............\..\timer.sld_design_entry_dsc.sci
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.............\LIB.DLS
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.............\svc_timer.qpf
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.............\time.acf
.............\time.hif
.............\timer.acf
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.............\timer.fit.rpt
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.............\timer.v
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.............\U0127638.DLS
.............\管脚分配说明.txt