文件名称:Clock_Synchronization_Module
下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
介绍说明－－下载内容均来自于网络，请自行研究使用
数字接收机中频部分数字时钟的设计
包括matlab仿真
verilog代码、
testbench代码
以及word设计文档(Design of medium frequency digital clock in digital receiver
Including Matlab simulation
Verilog, testbench code, and design documents)相关搜索： 频谱分析数字部分时钟同步模块
包括matlab仿真
verilog代码、
testbench代码
以及word设计文档(Design of medium frequency digital clock in digital receiver
Including Matlab simulation
Verilog, testbench code, and design documents)相关搜索： 频谱分析数字部分时钟同步模块
(系统自动生成,下载前可以参看下载内容)