文件名称:Quaalu
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ALU算术逻辑单元的简单实现,利用VHDL语言编写,可进行加法,减法,以及位的左右移动,只需一个时钟脉冲-ALU arithmetic logic unit to achieve a simple, using VHDL language, can be additive, subtractive, and the place and move around only one clock pulse相关搜索： alu
vhdl
加法
VHDL
alu
verilog
vhdl
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VHDL
alu
verilog
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alu
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