文件名称:b8bit_adder

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 508kb
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8位的加法器设计,分4个工程完成的,用的是Quartus II软件。-eight of the adder design, four hours to complete the project, using the Quartus II software.
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quartus
II
加法器

(系统自动生成,下载前可以参看下载内容)

下载文件列表

b8_adder

........\b8_adder.asm.rpt

........\b8_adder.done

........\b8_adder.fit.eqn

........\b8_adder.fit.rpt

........\b8_adder.fit.summary

........\b8_adder.flow.rpt

........\b8_adder.map.eqn

........\b8_adder.map.rpt

........\b8_adder.map.summary

........\b8_adder.pin

........\b8_adder.pof

........\b8_adder.qpf

........\b8_adder.qsf

........\b8_adder.qws

........\b8_adder.sim.rpt

........\b8_adder.sof

........\b8_adder.tan.rpt

........\b8_adder.tan.summary

........\b8_adder.vhd

........\b8_adder.vwf

........\cmp_state.ini

........\db

........\..\b8_adder.asm.qmsg

........\..\b8_adder.cbx.xml

........\..\b8_adder.cmp.cdb

........\..\b8_adder.cmp.hdb

........\..\b8_adder.cmp.rdb

........\..\b8_adder.cmp.tdb

........\..\b8_adder.cmp0.ddb

........\..\b8_adder.db_info

........\..\b8_adder.eco.cdb

........\..\b8_adder.eds_overflow

........\..\b8_adder.fit.qmsg

........\..\b8_adder.fnsim.cdb

........\..\b8_adder.fnsim.hdb

........\..\b8_adder.hier_info

........\..\b8_adder.hif

........\..\b8_adder.map.cdb

........\..\b8_adder.map.hdb

........\..\b8_adder.map.qmsg

........\..\b8_adder.pre_map.cdb

........\..\b8_adder.pre_map.hdb

........\..\b8_adder.psp

........\..\b8_adder.rtlv.hdb

........\..\b8_adder.rtlv_sg.cdb

........\..\b8_adder.rtlv_sg_swap.cdb

........\..\b8_adder.sgdiff.cdb

........\..\b8_adder.sgdiff.hdb

........\..\b8_adder.signalprobe.cdb

........\..\b8_adder.sim.hdb

........\..\b8_adder.sim.qmsg

........\..\b8_adder.sim.rdb

........\..\b8_adder.sim.vwf

........\..\b8_adder.sld_design_entry.sci

........\..\b8_adder.sld_design_entry_dsc.sci

........\..\b8_adder.syn_hier_info

........\..\b8_adder.tan.qmsg

........\..\b8_adder_cmp.qrpt

........\..\b8_adder_sim.qrpt

........\Waveform1.vwf

f_adder

.......\cmp_state.ini

.......\db

.......\..\f_adder.asm.qmsg

.......\..\f_adder.cbx.xml

.......\..\f_adder.cmp.cdb

.......\..\f_adder.cmp.hdb

.......\..\f_adder.cmp.rdb

.......\..\f_adder.cmp.tdb

.......\..\f_adder.cmp0.ddb

.......\..\f_adder.db_info

.......\..\f_adder.eco.cdb

.......\..\f_adder.eds_overflow

.......\..\f_adder.fit.qmsg

.......\..\f_adder.fnsim.cdb

.......\..\f_adder.fnsim.hdb

.......\..\f_adder.hier_info

.......\..\f_adder.hif

.......\..\f_adder.map.cdb

.......\..\f_adder.map.hdb

.......\..\f_adder.map.qmsg

.......\..\f_adder.pre_map.cdb

.......\..\f_adder.pre_map.hdb

.......\..\f_adder.psp

.......\..\f_adder.rtlv.hdb

.......\..\f_adder.rtlv_sg.cdb

.......\..\f_adder.rtlv_sg_swap.cdb

.......\..\f_adder.sgdiff.cdb

.......\..\f_adder.sgdiff.hdb

.......\..\f_adder.signalprobe.cdb

.......\..\f_adder.sim.hdb

.......\..\f_adder.sim.qmsg

.......\..\f_adder.sim.rdb

.......\..\f_adder.sim.vwf

.......\..\f_adder.sld_design_entry.sci

.......\..\f_adder.sld_design_entry_dsc.sci

.......\..\f_adder.syn_hier_info

.......\..\f_adder.tan.qmsg

.......\..\f_adder_cmp.qrpt

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