文件名称:shuzizhong

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [WORD]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 416kb
  • 下载次数:
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设计一个能进行时、分、秒计时的十二小时制或二十四小时制的数字钟,并具有定时与闹钟功能,能在设定的时间发出闹铃音,能非常方便地对小时、分钟和秒进行手动调节以校准时间,每逢整点,产生报时音报时。

实验平台:

1. 一台PC机;

2. MAX+PLUSII10.1。

Verilog HDL语言实现,还有完整的实验报告-The design of a can be hours, minutes, seconds time of 12 hours or 24 hours system, digital clock, and has from time to time with the alarm clock function, can be set to issue a sound alarm can be very convenient to hours, minutes and seconds for manual adjustment to calibrate the time, whenever there is the whole point, resulting in timekeeping timekeeping tone. Experimental platform: 1. A PC machine 2. MAX+ PLUSII10.1. Verilog HDL language, as well as a complete experimental report
(系统自动生成,下载前可以参看下载内容)

下载文件列表

shuzizhong

..........\clock

..........\.....\clo.acf

..........\.....\clo.fit

..........\.....\clo.gdf

..........\.....\clo.hex

..........\.....\clo.hif

..........\.....\clo.mmf

..........\.....\clo.ndb

..........\.....\clo.pin

..........\.....\clo.pof

..........\.....\clo.rpt

..........\.....\clo.scf

..........\.....\clo.snf

..........\.....\clo.sof

..........\.....\clo.ttf

..........\.....\clock.acf

..........\.....\clock.fit

..........\.....\clock.hex

..........\.....\clock.hif

..........\.....\clock.mmf

..........\.....\clock.ndb

..........\.....\clock.pin

..........\.....\clock.pof

..........\.....\clock.rpt

..........\.....\clock.snf

..........\.....\clock.sof

..........\.....\clock.sym

..........\.....\clock.ttf

..........\.....\clock.v

..........\.....\LIB.DLS

..........\.....\U5834037.DLS

..........\数字钟实验报告.doc

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