文件名称:paobiao

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 43kb
  • 下载次数:
  • 1次
  • 提 供 者:
  • j**
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  • 下载说明:
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介绍说明--下载内容均来自于网络,请自行研究使用

一个基于FPGA的数字跑表系统的设计,最小单位是百分表位。采用十进制进位。-FPGA-based digital stopwatch system design, the smallest unit is a digital dial indicator. Binary using the metric system.
相关搜索: 跑表
stopwatch
digital
vhdl

(系统自动生成,下载前可以参看下载内容)

下载文件列表

实战训练3 数字跑表

...................\cmp_state.ini

...................\DOC

...................\...\说明.txt

...................\paobiao.asm.rpt

...................\paobiao.cdf

...................\paobiao.done

...................\paobiao.fit.eqn

...................\paobiao.fit.rpt

...................\paobiao.fit.summary

...................\paobiao.flow.rpt

...................\paobiao.map.eqn

...................\paobiao.map.rpt

...................\paobiao.map.summary

...................\paobiao.pin

...................\paobiao.pof

...................\paobiao.qpf

...................\paobiao.qsf

...................\paobiao.qws

...................\paobiao.saf

...................\paobiao.sim.rpt

...................\paobiao.sof

...................\paobiao.tan.rpt

...................\paobiao.tan.summary

...................\paobiao.vwf

...................\SRC

...................\...\paobiao.v

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