文件名称:risc

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 129kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 徐*
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用Verilog 编写的8位risc cpu,行为级描述,可综合-6 bits risc cpu by Verilog
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risc

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下载文件列表

risc

....\alu.v

....\cpu.v

....\cpu_test.flow.rpt

....\cpu_test.map.rpt

....\cpu_test.map.summary

....\cpu_test.qpf

....\cpu_test.qsf

....\cpu_test.qws

....\cpu_test.v

....\db

....\..\cpu_test.cbx.xml

....\..\cpu_test.cmp.rdb

....\..\cpu_test.db_info

....\..\cpu_test.eco.cdb

....\..\cpu_test.hif

....\..\cpu_test.map.qmsg

....\..\cpu_test.map_bb.hdb

....\..\cpu_test.sld_design_entry.sci

....\..\cpu_test.tis_db_list.ddb

....\dram.v

....\exp.v

....\idec.v

....\incremental_db

....\..............\compiled_partitions

....\..............\README

....\pram.v

....\regs.v

....\risc.cr.mti

....\risc.mpf

....\risc8.vcd

....\vsim.wlf

....\work

....\....\alu

....\....\...\verilog.psm

....\....\...\_primary.dat

....\....\...\_primary.dbs

....\....\...\_primary.vhd

....\....\cpu

....\....\...\verilog.psm

....\....\...\_primary.dat

....\....\...\_primary.dbs

....\....\...\_primary.vhd

....\....\cpu_test

....\....\........\verilog.psm

....\....\........\_primary.dat

....\....\........\_primary.dbs

....\....\........\_primary.vhd

....\....\dram

....\....\....\verilog.psm

....\....\....\_primary.dat

....\....\....\_primary.dbs

....\....\....\_primary.vhd

....\....\exp

....\....\...\verilog.psm

....\....\...\_primary.dat

....\....\...\_primary.dbs

....\....\...\_primary.vhd

....\....\idec

....\....\....\verilog.psm

....\....\....\_primary.dat

....\....\....\_primary.dbs

....\....\....\_primary.vhd

....\....\pram

....\....\....\verilog.psm

....\....\....\_primary.dat

....\....\....\_primary.dbs

....\....\....\_primary.vhd

....\....\regs

....\....\....\verilog.psm

....\....\....\_primary.dat

....\....\....\_primary.dbs

....\....\....\_primary.vhd

....\....\_info

....\....\_temp

....\....\_vmake

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