Core8051

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........\...........\......\...\......\...........\verilog

........\...........\......\...\M7AFS600-2

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........\...........\......\...\..........\.......\timingshell

........\...........\......\...\..........\.......\...........\verilog

........\...........\......\COREUART

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........\...........\......\........\...\.............\COREUART_LIB

........\...........\......\........\...\.............\............\@c@o@r@e@u@a@r@t

........\...........\......\........\...\.............\............\@c@u@a@r@t@o1

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........\...........\......\........\...\.............\............\@clock_gen

........\...........\......\........\...\.............\............\@rx_async

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........\...........\......\........\...\.............\............\testbnch

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........\...........\......\........\...\....\....\verif

........\...........\r

........\...........\.\BusDefinitions

........\...........\.\r_A7S

........\...........\ws

........\...........\..\BusDefinitions

........\...........\..\ws_COREUART

........\designer

........\........\impl1

........\........\.....\simulation

........\........\.....\USER_CORE8051.dtf

........\........\.....\USER_CORE8051_fp

........\........\.....\................\projectData

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........\phy_synthesis

........\simulation

........\smartgen

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........\........\RAM2048X8

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........\Core8051.prj

........\coreconsole\common\A7S\A7S.cxf

........\...........\......\...\bfm\compiler\bfmCompile.tcl

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........\...........\......\...\...\...\.......\a7sBFM_TS.v

........\...........\......\...\...\subsystem.bfm

........\...........\......\...\common\timingshell\verilog\arm_other.v

........\...........\......\...\M7AFS600-2\nodebug\constraints\arm_palace.pdc

........\...........\......\...\..........\.......\layout\arm_designer.cdb

........\...........\......\...\..........\.......\timingshell\arm_palace.lib

........\...........\......\...\..........\.......\...........\verilog\arm_precision.v

........\...........\......\...\..........\.......\...........\.......\arm_synplify.v

........\...........\......\COREUART\coreparameters.v

........\...........\......\........\COREUART.cxf

........\...........\......\........\mti\lib_vlog_eval\COREUART_LIB\@c@o@r@e@u@a@r@t\verilog.psm

........\...........\......\........\...\.............\............\................\_primary.dat

........\...........\......\........\...\.............\............\................\_primary.vhd

........\...........\......\........\...\.............\............\...u@a@r@t@o1\verilog.psm

........\...........\......\........\...\.............\............\.............\_primary.dat