文件名称:cordic

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [ASM] [源码]
  • 上传时间:
  • 2013-10-20
  • 文件大小:
  • 188kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • yul****
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  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

verilog实现的cordic算法,很好的代码,实际项目中使用过的。-verilog cordic
(系统自动生成,下载前可以参看下载内容)

下载文件列表





cordic\abs(1).v

......\abs.v

......\add_sub(1).v

......\add_sub.v

......\add_sub.v(1).bak

......\add_sub.v.bak

......\cordic(1).mpf

......\cordic.cr(1).mti

......\cordic.cr.mti

......\cordic.mpf

......\cordic_atan(1).v

......\cordic_atan.v

......\fape(1).v

......\fape.v

......\fape.v(1).bak

......\fape.v.bak

......\fape_tb(1).v

......\fape_tb.v

......\fape_tb.v(1).bak

......\fape_tb.v.bak

......\pe(1).v

......\pe.v

......\pe.v(1).bak

......\pe.v.bak

......\pe_tb(1).v

......\pe_tb.v

......\pe_tb.v(1).bak

......\pe_tb.v.bak

......\phase_diff(1).v

......\phase_diff.v

......\qc(1).v

......\qc.v

......\qm(1).v

......\qm.v

......\transcript

......\vsim.wlf

......\work\abs\verilog(1).asm

......\....\...\_primary(1).dat

......\....\...\_primary(1).vhd

......\....\...\_primary.dat

......\....\...\_primary.dbs

......\....\...\_primary.vhd

......\....\.dd_sub\verilog(1).asm

......\....\.......\verilog.asm

......\....\.......\verilog.rw

......\....\.......\_primary(1).dat

......\....\.......\_primary(1).vhd

......\....\.......\_primary.dat

......\....\.......\_primary.dbs

......\....\.......\_primary.vhd

......\....\cordic_atan\verilog(1).asm

......\....\...........\_primary(1).dat

......\....\...........\_primary(1).vhd

......\....\...........\_primary.dat

......\....\...........\_primary.dbs

......\....\...........\_primary.vhd

......\....\fape\verilog(1).asm

......\....\....\verilog.asm

......\....\....\verilog.rw

......\....\....\_primary(1).dat

......\....\....\_primary(1).vhd

......\....\....\_primary.dat

......\....\....\_primary.dbs

......\....\....\_primary.vhd

......\....\...._tb\verilog(1).asm

......\....\.......\verilog.asm

......\....\.......\verilog.rw

......\....\.......\_primary(1).dat

......\....\.......\_primary(1).vhd

......\....\.......\_primary.dat

......\....\.......\_primary.dbs

......\....\.......\_primary.vhd

......\....\pe\verilog(1).asm

......\....\..\verilog.asm

......\....\..\verilog.rw

......\....\..\_primary(1).dat

......\....\..\_primary(1).vhd

......\....\..\_primary.dat

......\....\..\_primary.dbs

......\....\..\_primary.vhd

......\....\.._tb\verilog(1).asm

......\....\.....\_primary(1).dat

......\....\.....\_primary(1).vhd

......\....\.....\_primary.dat

......\....\.....\_primary.dbs

......\....\.....\_primary.vhd

......\....\.hase_diff\verilog(1).asm

......\....\..........\_primary(1).dat

......\....\..........\_primary(1).vhd

......\....\..........\_primary.dat

......\....\..........\_primary.dbs

......\....\..........\_primary.vhd

......\....\qc\verilog(1).asm

......\....\..\_primary(1).dat

......\....\..\_primary(1).vhd

......\....\..\_primary.dat

......\....\..\_primary.dbs

......\....\..\_primary.vhd

......\....\.m\verilog(1).asm

......\....\..\_primary(1).dat

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