文件名称:qdq

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [Text]
  • 上传时间:
  • 2013-05-20
  • 文件大小:
  • 2kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 李*
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设计一个可容纳6组(或4组)参赛的数字式抢答器,每组设一个按钮,供抢答使用。 抢答器具有第一信号鉴别和锁存功能,使除第一抢答者外的按钮不起作用。 设置一个主持人“复位”按钮。 主持人复位后,开始抢答,第一信号鉴别锁存电路得到信号后,有指示灯显示抢答组别,扬声器发出2~3秒的音响。 设置一个计分电路,每组开始预置100分,由主持人记分,答对一次加10分,答错一次减10分

-The design can accommodate a group (or groups) participating in the Digital Responder, each with a button for the answer in use. Responder has a first signal to identify and latch function, in addition to the first answer button does not work. Set a moderator " reset" button. After the reset of the host, began to answer, the identification of the first signal latch circuit signal indicator Responder group, audio speaker 2 to 3 seconds. Set up a scoring circuit, each began to preset 100 points, scoring by the moderator, answer 10 points, got it wrong once by 10 points
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