文件名称:RS_enc

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2014-12-18
  • 文件大小:
  • 15kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 王*
  • 相关连接:
  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

RS编码器设计,使用Verilog实现。-RS encoder design, Verilog implementation.
(系统自动生成,下载前可以参看下载内容)

下载文件列表





RS编码器

........\mul_encode.vhd

........\mula_0.v

........\mula_1.v

........\mula_10.v

........\mula_11.v

........\mula_12.v

........\mula_13.v

........\mula_14.v

........\mula_15.v

........\mula_16.v

........\mula_17.v

........\mula_18.v

........\mula_2.v

........\mula_21.v

........\mula_22.v

........\mula_25.v

........\mula_3.v

........\mula_31.v

........\mula_32.v

........\mula_35.v

........\mula_38.v

........\mula_4.v

........\mula_45.v

........\mula_48.v

........\mula_5.v

........\mula_51.v

........\mula_59.v

........\mula_6.v

........\mula_61.v

........\mula_7.v

........\mula_8.v

........\mula_9.v

........\rscode.v

........\rscode.vhd

........\rscode.vwf

........\rstestbench.vhd

........\testbenchmul.vhd

........\testbenchmul_encode.vhd

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