文件名称:timing_constraints

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • 上传时间:
  • 2018-03-07
  • 文件大小:
  • 12kb
  • 下载次数:
  • 0次
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  • 小李***
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介绍说明--下载内容均来自于网络,请自行研究使用

方法能够自动地约束 PLL 的输入和输出时钟。ALTPLL megafunction 中指定的所有 PLL 参数都用于约束 PLL 的输入和输出时钟。(Methods can automatically constrain PLL input and output clock.Named in ALTPLL megafunction.All PLL parameters are used to constrain PLL input and output clocks.)
相关搜索: time
constant
verilog

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下载文件列表

文件名大小更新时间
timing_constraints\rtl\constraints.v 1351 2011-04-04
timing_constraints\synth\Analysis 1 Constraints Interaction.tsi 5151 2011-04-09
timing_constraints\synth\constraints.lso 6 2011-04-04
timing_constraints\synth\constraints.ptwx 18825 2011-04-09
timing_constraints\synth\constraints.stx 0 2011-04-04
timing_constraints\synth\constraints.tsi 5463 2011-04-09
timing_constraints\synth\constraints.ucf 518 2011-04-09
timing_constraints\synth\constraints.unroutes 154 2011-04-09
timing_constraints\synth\constraints.xpi 45 2011-04-09
timing_constraints\synth\constraints_map.mrp 9202 2011-04-09
timing_constraints\synth\synth.xise 6998 2011-04-09
timing_constraints\rtl 0 2011-04-30
timing_constraints\synth 0 2011-04-30
timing_constraints 0 2011-04-30

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