文件名称:verilog_PLL

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • 上传时间:
  • 2017-07-07
  • 文件大小:
  • 11kb
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全数字锁相环的verilog源代码,包括鉴相器,K变摸可逆计数器,加减脉冲器和N分频器。已经仿真实现。(All digital phase-locked loop Verilog source code, including phase discriminator, K variable touch reversible counter, add and subtract pulse and N frequency divider. Have been implemented by simulation.)
相关搜索: 全数字锁相环
verilog

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