[VHDL编程] structural

说明：4:2 ENCODER USING STRUCTURAL MODELING
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[VHDL编程] CameraLink_Oserdes2_test

说明：40M时钟输入经过iserdes倍频到960M-input 40M o clock and output 960M
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[VHDL编程] CLK_TEST

说明：VHDL实现的8分频程序，经测试，在板上运行成功-8 divided clock
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[VHDL编程] VGA_256

说明：基于FPGA的VGA驱动，能在显示器上实现256色-FPGA-based VGA driver to achieve 256 colors on the display
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[VHDL编程] 10010_xu_lie_jian_ce_qi

说明：基于FPGA的序列检测器，能检测10010序列-FPGA-based sequence detector can detect a sequence 10010
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[VHDL编程] an_jian_xiao_dou

说明：基于FPGA的按键消抖设计代码，能实现按键消抖功能-Key debounce FPGA-based design code, to achieve key debounce function
<huang> 在 2025-06-10 上传 | 大小：324kb | 下载：0

[VHDL编程] Johnson_counter

说明：基于FPGA的Jhonson计数器，能用按键控制流水灯-FPGA-based Jhonson counter, can control buttons light water
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[VHDL编程] counter7

说明：4bit counter in verilog
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[VHDL编程] mux_3_conditional

说明：implementation of multiplexer using conditional operator
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[VHDL编程] mux3_case

说明：implementation of multiplexer using case statements in verilog
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[VHDL编程] mux3_if_else

说明：implementation of multiplexer using if else statement in verilog
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[VHDL编程] CPU_MODEL

说明：implementation of CPU model using verilog
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