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[VHDL编程Detailed_Analysis_of_Verilog_language

说明:Verilog语言详细解析Detailed Analysis of Verilog language-Verilog language detailed analysis Detailed Analysis of Verilog language
<daivi> 在 2025-06-09 上传 | 大小:259kb | 下载:0

[VHDL编程Verilog_classic_documentation

说明:Verilog经典文档资料Verilog classic documentation很不错的经典资料-Verilog classic documentation Verilog classic documentation is very good classical information
<daivi> 在 2025-06-09 上传 | 大小:2.34mb | 下载:0

[VHDL编程verilog_classic_example_of_a_collection

说明:verilog经典实例集合verilog classic example of a collection-a collection of classic examples of verilog verilog classic example of a collection
<daivi> 在 2025-06-09 上传 | 大小:162kb | 下载:0

[VHDL编程Verilog_HDL_company_information

说明:Verilog HDL 公司内部资料Verilog HDL company information-Internal information Verilog HDL Verilog HDL company information
<daivi> 在 2025-06-09 上传 | 大小:257kb | 下载:0

[VHDL编程Verilog_HDL_Programming_Guide

说明:Verilog HDL程序设计指南Verilog HDL Programming Guide-Programming Guide Verilog HDL Verilog HDL Programming Guide
<daivi> 在 2025-06-09 上传 | 大小:203kb | 下载:0

[VHDL编程pingpong

说明:verilog描述的乒乓球游戏,在FPGA上已经验证成功-verilog descr iption of the table tennis game, has been successfully verified in FPGA
<立为> 在 2025-06-09 上传 | 大小:2kb | 下载:0

[VHDL编程DSPAlgorithms

说明:数字信号处理算法的优化以及硬件描述语言实现-DSPAlgorithms
<LuChuan> 在 2025-06-09 上传 | 大小:1.27mb | 下载:0

[VHDL编程tt

说明:在Quartus中实现256的RAM(经过实际的应用验证).rar-Realized in the Quartus 256 RAM (after the actual application of verification). Rar
<乐文锋> 在 2025-06-09 上传 | 大小:152kb | 下载:0

[VHDL编程clk_div3

说明:在fpga中对于pll无法完成的分频,可采用计数方式,本例用状态机实现对时钟的奇数分频。-Pll in fpga can not be completed in the sub-frequency counting method can be used, in this case with the state machine to achieve an odd number on the clock frequency.
<郝强> 在 2025-06-09 上传 | 大小:275kb | 下载:0

[VHDL编程DDS

说明:本代码在fpga中实现了dds,程序有三个按键:一个控制产生的波形(正弦波或方波),另两个控制频率增加或降低。程序附有注释,并在signaltap中仿真成功。-The code is implemented in fpga a dds, program has three buttons: a control generated waveform (sine or square wave), the other two control the frequency increase or decr
<郝强> 在 2025-06-09 上传 | 大小:2.07mb | 下载:0

[VHDL编程lcd_time

说明:一个基于VHDL的多功能数字钟设计,能在LCD上显示时间,调整时间,整点报时,音乐为美妙的梁祝。-A VHDL-based design of multi-functional digital clock that can display time in the LCD, adjust the time, the whole point of time, music was wonderful Butterfly Lovers.
<周殿凤> 在 2025-06-09 上传 | 大小:192kb | 下载:0

[VHDL编程ledplay

说明:基于VHDL的各种流水灯的显示,程序简洁,占用资源少-VHDL-based light display a variety of water, the program simple and less resource
<周殿凤> 在 2025-06-09 上传 | 大小:213kb | 下载:0
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