[VHDL编程] CPU

说明：使用QuartusII软件，利用VHDL语言设计实现CPU,其中包含时序图仿真。-Using software QuartusII, using VHDL language to design the CPU, which contains sequence diagram simulation.
<段绍丽> 在 2025-06-30 上传 | 大小：2.43mb | 下载：1

[VHDL编程] sht30

说明：温湿度传感器SHT30驱动，功能实现从传感器中读出数据。-sensor sht30 driver. read temperature and humidity data sensor.
<钱愈玉> 在 2025-06-30 上传 | 大小：3kb | 下载：1

[VHDL编程] filter_VHDL

说明：FIR filter design using VHDL for 32 bit signed coefficientand 32 bit input and decimation is 4 and its working good
<shyamu> 在 2025-06-30 上传 | 大小：49kb | 下载：1

[VHDL编程] LED_RUN

说明：verilog 流水灯程序 简单易懂 很好-verilog Light water program easy to understand well
<changrenhe> 在 2025-06-30 上传 | 大小：174kb | 下载：1

[VHDL编程] RSdecoder

说明：自己写的基于verilog的RS译码器，能够实现RS(240，224)码译码，一级流水设计，可连续译码也可非连续译码。-RSdecoder for RS(240,224).
<opudn89> 在 2025-06-30 上传 | 大小：11kb | 下载：1

[VHDL编程] AD9640

说明：这是用erilog语言编写的控制100M/150M高速AD9640的程序，适用于FPGA，亲测可用，供参考。-this is a program for FPGA to control AD9640, which is useful by verilog.
<xuliming> 在 2025-06-30 上传 | 大小：9.06mb | 下载：1

[VHDL编程] FPGA_verilog_uart-

说明：基于 FPGA器件设计实现UART的波特率产生器、UART发送器和接收器及其整合电路,，利用Veriolog-HDL语言对这三个功能模块进行描述并加以整合，通过ModelSim仿真，用串口调试程序进行验证，最终实现一个通用异步收发器的设计。-UART baudrate generator, transmitter and receiver and its integrated circuit are implemented by FPGA device. Using Veriolog-HDL d
<孔春伟> 在 2025-06-30 上传 | 大小：3.02mb | 下载：1

[VHDL编程] src

说明：verilog 通过串口控制VGA显示黑白机彩色棋盘 开发板是Xilinz RQ208-Color display in black and white machine control board through the serial port VGA Development Boards
<任意> 在 2025-06-30 上传 | 大小：8kb | 下载：1

[VHDL编程] mdio_vhdl

说明：mdio slave code with state machine
<pan yuming> 在 2025-06-30 上传 | 大小：2kb | 下载：1

[VHDL编程] addersub4

说明：用拨码开关输入两个四位二进制数，按下运算按钮后，以 led 的方式显示运算的结果。拓展 1 ．在基本功能实现前提下，增加一个清零功能。 2 ．更换显示方式，结果用数码管进行显示。 3 ．对溢出值的考虑。如果发生溢出现象，则数码管显示“ E ”。 -Use DIP switches to enter two four binary numbers, press the operation button to display the results led the operation
<栗荀> 在 2025-06-30 上传 | 大小：3kb | 下载：1

[VHDL编程] scope_new

说明：本实验，为 ZX-2 开发板的综合实验，该实验利用 ZX-2 开发板上的 ADC、独 立按键、 UART 等外设， 搭建了一个具备丰富功能的数据采集卡， ZX-2 开发板负 责进行数据的采集并将数据通过串口发送到 PC 机上， PC 端，利用强大的串口调 试工具——串口猎人，来实现数据的接收分析，并将数据分别以波形、码表、柱 状图的形式动态显示出来，以让使用者能够直观的看到 ADC 采集到的信号细节。 同时，用户也可以使用串口猎人通过串口给下位机（ FPGA） 发送指令，下位
<啧啧啧> 在 2025-06-30 上传 | 大小：23.27mb | 下载：1

[VHDL编程] AFE0064

说明：AFE0064模拟前端芯片代码，使用verilog语言实现。-TI AFE0064 analog-front-end code with the verilog language
<wangk> 在 2025-06-30 上传 | 大小：251kb | 下载：1