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[VHDL编程] modelsim-timing-analysis
说明:自己整理的一个关于如何使用modelsim进行功能仿真,时序仿真和布局布线的后仿真的文档,例子是抄的,针对的版本是modelsim se6.2b-Their finishing a feature on how to use modelsim for simulation, timing simulation and post-layout simulation of the document, copy the example is for the version of modelsim se<雍振强> 在 2025-06-18 上传 | 大小:689kb | 下载:0
[VHDL编程] jieshoufasong
说明:实现FPGA和PC机之间的通信。PC机发送的数据可以通过FPGA显示在数码管上;FPGA通过按键发送的数据可以显示在PC机的串口调试助手上。-Communication between the FPGA and the PC. PC sends the data can be displayed through the FPGA digital tube FPGA through the button to send the data can be displayed on a PC seri<xiaotian> 在 2025-06-18 上传 | 大小:690kb | 下载:0