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[VHDL编程] my_code
说明:编码器和译码器,Verilog实现,有具体实验说明文档。-Encoder and decoder, Verilog realization of a specific experiment documentation.<mypudn0001> 在 2025-06-16 上传 | 大小:1.55mb | 下载:0
[VHDL编程] multiplexer_ise10migration
说明:this a implementation of multiplexer-this is a implementation of multiplexer<liudm0> 在 2025-06-16 上传 | 大小:1.55mb | 下载:0
[VHDL编程] viterbi_hard
说明:(2,1,3)卷积码编码,硬判决译码;编码是matlab语言,译码是verilog语言-(2,1,3) convolutional code encoding, hard decision decoding coding is matlab language, decoding is verilog language<刘星麟> 在 2025-06-16 上传 | 大小:1.55mb | 下载:0