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[VHDL编程PN

说明:利用vhdl语言编程实现的pn码产生.在quartus ii中通过-The use of VHDL language programming code generated realize the pn. Quartus ii adopted in
<zhangtian> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程111

说明:statemachine it can detecate statemachine
<jiashuheng> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程crc

说明:可以直接用于工程应用的crc校验VHDL编码 里面有详细的规格书-Can be directly used for engineering applications of CRC checksum inside VHDL code has detailed specifications
<毋杰> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程SoCWishboneSystem

说明:SoC-Wishbone System IP核的VHDL语言源代码-SoC-Wishbone System IP core language VHDL source code
<肖冠兰> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程testbench

说明:how to write testbench,use vhdl-how to write testbench, use vhdl
<hxl> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程pinlvji

说明:频率计VHDL编程。设计一个4位数字显示的十进制频率计,其测量范围为1MHz,测量值通过4个数码管显示以8421BCD码形式输出,可通过开关实现量程控制,量程分10kHz、100kHz、1MHz三档(最大读数分别为9.999kHz、99.99kHz、999.9kHz); 当输入信号的频率大于相应量程时,有溢出显示。 -Cymometer VHDL programming. Design of a 4-digit decimal display frequency, the measure
<zhangyi> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程FIFO_Design

说明:一种基于格雷码的异步FIFO设计与实现,8*8位的fifo VHDL 源码-Gray-code based on the Asynchronous FIFO Design and Implementation
<qwe> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程TUT1_BASIC1_7C5TP

说明:FPGA的89S51IP核,可以用FPGA实现51,省去了很多的麻烦-FPGA-89S51IP core
<邱柳钦> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程15252uP(1)

说明:这是8位微处理器的Verilog源代码,可以欠在Flex10k10里面-This is the 8-bit microprocessor Verilog source code, can they owed in Flex10k10
<hbei> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程TestBench

说明:怎样写testbench 本文的实际编程环境:ISE 6.2i.03 ModelSim 5.8 SE Synplify Pro 7.6 编程语言 VHDL 在ISE 中调用ModelSim 进行仿真-、assert (s_cyi((DWIDTH-1)/4) = 0 ) and (s_ovi = 0 ) and (s_qutnt = conv_std_logic_vector(v_quot,DWIDTH)) and (s_rmndr = conv_std_log
<lei> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程EP2C5sch

说明:
<zqhkd> 在 2025-06-26 上传 | 大小:88kb | 下载:0

[VHDL编程eda

说明:eda实验中常用到的模块,语言为VHDL-eda commonly used in experiments to the module, language VHDL
<闫更辉> 在 2025-06-26 上传 | 大小:88kb | 下载:0
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