[VHDL编程] MAIN_RX_V10

说明：8路视频光端机 接收侧 VHDL源码，使用了千兆以太网SERDES芯片，基于TBI接口的PCM视频传输。-8-Channel Video Optical Receiver side of VHDL source code, using the Gigabit Ethernet SERDES chip, based on the TBI interface PCM video transmission.
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[VHDL编程] fulladder

说明：Simple four bit full adder using concatenation in VHDL.
<Aaqib> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] DDS_100325(13)_success

说明：QUARTUS II环境下VHDL语言编写DDS程序，双数字信号输出，一为正弦波幅值输出，一正弦波差值信号。时钟2^21HZ，带24bits频率控制字。-QUARTUS II environment, VHDL language DDS program, two digital signal output, an amplitude for the sine wave output, a sine wave difference signal. Clock 2 ^ 21HZ, with 24bi
<骆东君> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] SMBus_xapp353

说明：SMBUS vhdl source code
<taiwan> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] rgb2yuv1

说明：这个主要是实现RGB和YUV两种色彩空间的转换，其中用到的主要思想是，verilog语言中的浮点乘法怎么运算，流水线的思想。-This is achieved mainly two kinds of RGB and YUV color space conversion, which uses the main idea is, verilog language how floating point multiplication operations, lines of thought.
<张元甲> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] led-decoder

说明：7 segment display decoder vhdl project
<dumbmage> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] verilogPPT

说明：verilog基本语法，便于查询和使用，是学习verilog不可或缺的语法书，便于记忆，使用方便-verilog basic syntax, ease of access to and use is essential to learn verilog grammar book, easy to remember, easy to use
<厉恩鹏> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] Design-Space-Exploration-of-Hard-Decision-Viterbi

说明：Space Exploration of Hard-Decision Viterbi Decoding: Algorithm and VLSI Implementation
<saravanan> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] I50550PWM_V55m

说明：FPGA 实现一种基于ISA接口的3路编码器计数，与3路PWM/DDA输出编码器计数包含倍频、鉴相PWM实现12位分辨率 已通过测试。 -FPGA implementation based on the ISA interface, 3 channel encoder count, and 3-way PWM/the DDA output encoder count contains a multiplier, the phase PWM 12-bit resolution has been
<偏见> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] TS_i2c

说明：基于xilinx spartan 3e 开发板的CAT34TS02 AT30TSE002B 等 带有温度传感器EEPROM 的TS 部分测试程序。通过串口写入数据和地址。按键控制从串口读出内部寄存器值，同时LCD予以16进制显示。 本人编写亲测。-Based on the xilinx spartan 3e development boards CAT34TS02 AT30TSE002B TS part of the test program with a temperature senso
<李华> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] viterbi-decoder-verilog

说明：viterbi verilog implemetation based matlab-viterbi verilog implemetation based matlab
<kim jan> 在 2025-06-21 上传 | 大小：1.04mb | 下载：0

[VHDL编程] 32bitvedic and square

说明：32 bit vedic multiplier documentation
<vysh > 在 2025-06-21 上传 | 大小：1.04mb | 下载：0