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[VHDL编程] 2
说明:设计一个具有时、分、秒计时的电子钟,按24小时计时。要求: (1)数字钟的时间用六位数码管分别显示时、分、秒; (2)用两个控制键,对数字钟分别进行分、时校正; (3)具有仿广播电台整点报时的功能。即每逢59分51秒、53秒、55秒及57秒时,发出4声500Hz低音,在59分59秒时发出一声1kHz高音,它们的持续时间均为1秒。最后一声高音结束的时刻恰好为正点时刻。 (4)具有定时闹钟功能,且最长闹铃时间为1分钟。要求可以任意设置闹钟的时、分;闹铃信号为500Hz和1kHz的方波信号,两<LIMBO2K > 在 2025-06-08 上传 | 大小:51kb | 下载:0
[VHDL编程] 状态机
说明:设计一个简单的数字电路用于电子卖报机,要求如下: 报纸价格为1.5元;投币器只接受5角和1元硬币;投币器不找零。当投入金额合适时,报纸出口打开,否则关闭。用Verilog完成设计。(The design of a simple digital circuit for electronic selling machine, the following: The price is 1.5 yuan; the coin only accept 5 cents and $1 coin coin do<victorzn > 在 2025-06-08 上传 | 大小:1kb | 下载:0
[VHDL编程] pipelined_fft_128_latest.tar
说明:RTL IMplementaion for the project<Unnam > 在 2025-06-08 上传 | 大小:212kb | 下载:0
[VHDL编程] 硬件描述语言实验指导(1)
说明:此PPT为功能指导型的,便于学生学习VHDL语言和加深对编程的理解和运用。(This PPT is a functional guide for students to learn the VHDL language and to deepen the understanding and application of programming.)<海&角 > 在 2025-06-08 上传 | 大小:38.5mb | 下载:0
[VHDL编程] eetop.cn_Verilog HDL入门(第三版)【夏宇闻】
说明:veriloghdl数字设计与综合夏宇闻翻译(dgfsdghfhsgdfhgfddfghdfh)<petpat > 在 2025-06-08 上传 | 大小:4.63mb | 下载:0