[VHDL编程] 8-ADDER-VHDL

说明：用硬件描述语言编写的8位全加器代码，很实用！-Using hardware descr iption language preparation 8 bits QuanJia implement code, very useful!!
<王浩彬> 在 2026-01-12 上传 | 大小：1kb | 下载：0

[VHDL编程] HALF-ADDER-VHDL

说明：用硬件描述语言编写的8位全加器代码，很实用通过对代码的编译和波形检测显示出此设计也是完全符合要求的，并且和设计的电路图一样，也达到相同的效果。-Using hardware descr iption language preparation 8 bits QuanJia implement code, is very practical through the code compiler and waveform test shows the design is fully meet the r
<王浩彬> 在 2026-01-12 上传 | 大小：1kb | 下载：0

[VHDL编程] CLA4

说明：Carry look Ahead Adder using top level
<Yanal> 在 2026-01-12 上传 | 大小：52kb | 下载：0

[VHDL编程] gam1

说明：A Low-power Variable-length FFT Processor Base on Radix-24 Algorithm
<rams> 在 2026-01-12 上传 | 大小：1.18mb | 下载：0

[VHDL编程] gam2

说明：A Low-power Variable-length FFT Processor Base on Radix-24 Algorithm
<rams> 在 2026-01-12 上传 | 大小：968kb | 下载：0

[VHDL编程] gam3

说明：FPGA Implementation ofLow Power 64-Point Radix-4 FFT Processor for OFDM System
<rams> 在 2026-01-12 上传 | 大小：142kb | 下载：0

[VHDL编程] gam5

说明：FPGA Implementation ofLow Power 64-Point Radix-4 FFT Processor for OFDM System
<rams> 在 2026-01-12 上传 | 大小：1.22mb | 下载：0

[VHDL编程] gam7

说明：FPGA Implementation ofLow Power 64-Point Radix-4 FFT Processor for OFDM System
<rams> 在 2026-01-12 上传 | 大小：14.83mb | 下载：0

[VHDL编程] 12

说明：cordic algorithm using verilog code
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[VHDL编程] freefifo

说明：一个同步fifo的测试程序,里面包括fifo的源程序-a test program of sys fifo
<庄敏敏> 在 2026-01-12 上传 | 大小：5kb | 下载：0

[VHDL编程] 4QAM-NR

说明：这是基于2008国标DMB_TH中4QAM_NR映射的FPGA实现，其中包括映射表-This is based on the 2008 GB DMB_TH in 4QAM_NR mapped FPGA, including the mapping table
<庄敏敏> 在 2026-01-12 上传 | 大小：574kb | 下载：0

[VHDL编程] ASI_IN1_and_ASI_OUT1

说明：这是对于从卫星接收下来的TS流，有两路流，对其选择，其中包括同步模块，PCR校正模块，码率调整模块-This is received from the satellite down for the TS stream, there are two streams of their choice, including the synchronization module, PCR correction module, rate adjustment module
<庄敏敏> 在 2026-01-12 上传 | 大小：2.31mb | 下载：0