文件名称:68013FIFOIN
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Verilog HDL 编写的CY7C68013 SLAVE FIFO接口程序，实际测试可用。可以直接跟上位机连接，传输数据。-Verilog HDL prepared CY7C68013 SLAVE FIFO interface program, the actual test can be used. Keep pace with the digital machine can be directly connected to transmit data.相关搜索： 68013
FIFO
slave
fifo
fifo
verilog
verilog
cy7c68013
verilog
fifo
68013A
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..................\................\..\fifo_cntl.map.qmsg
..................\................\..\fifo_cntl.pre_map.cdb
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..................\................\..\fifo_cntl.sld_design_entry.sci
..................\................\..\fifo_cntl.sld_design_entry_dsc.sci
..................\................\..\fifo_cntl.tis_db_list.ddb
..................\................\..\prev_cmp_fifo_cntl.asm.qmsg
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..................\................\fifo_cntl_assignment_defaults.qdf
..................\同步自动输入固件
..................\................\build.bat
..................\................\dscr.a51
..................\................\DSCR.LST
..................\................\DSCR.OBJ
..................\................\Ezusb.lib
..................\................\fw.c
..................\................\FW.LST
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..................\................\readme.txt
..................\................\tcxmaster
..................\................\tcxmaster.c
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..................\................\tcxmaster.lnp
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