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文件名称:sdram_verilog

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 405kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

这是使用VERILOG语言，基于MICRON公司的SDRAM开发的SDRAM接口逻辑-verilog This is the use of language, MICRON-based company's development of the SDRAM SDRAM interface logic
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sdram_verilog
zip

(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog

.......\func_sim

.......\........\func_sim.cfg

.......\........\func_sim.log

.......\........\func_sim.vpd

.......\........\run_sim

.......\........\string_decode_fn.v

.......\........\tb_sdrm.v

.......\micron

.......\......\bank0.txt

.......\......\bank1.txt

.......\......\mt48lc1m16a1-8a.v

.......\......\mt48lc1m16a1.v

.......\......\test.v

.......\par

.......\...\run_par

.......\...\sdrm.edf

.......\...\sdrm.ucf

.......\...\sdrm_par.sdf

.......\...\sdrm_par.v

.......\post_route

.......\..........\post_route.cfg

.......\..........\post_route.log

.......\..........\post_route.vpd

.......\..........\run_sim

.......\..........\sdrm_par.sdf

.......\..........\sdrm_par.v

.......\..........\string_decode_post_route.v

.......\..........\tb_post_route.v

.......\README

.......\src

.......\...\brst_cntr.v

.......\...\cslt_cntr.v

.......\...\define.v

.......\...\ki_cntr.v

.......\...\rcd_cntr.v

.......\...\ref_cntr.v

.......\...\sdrm.v

.......\...\sdrmc_state.v

.......\...\sdrm_t.v

.......\...\sys_int.v

.......\synth

.......\.....\run_synth

.......\.....\sdrm.edf

.......\.....\sdrm.scr

.......\.....\setup.scr

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