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Altera-AHDL语言设计的PCI总线Core
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leon3-altera-ep1c20
- leon3 patch for altera ep1c20 FPGA.
leon3-altera-ep2s60-ddr
- This leon3 design is tailored to the Altera NiosII Startix2 Development board, with 16-bit DDR SDRAM and 2 Mbyte of SSRAM. As of this time, the DDR interface only works up to 120 MHz. At 130, DDR data can be r
cpu-leon3-altera-ep1c20
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并口的CPLD烧录线，通过跳线支持三大厂家的CPLD/FPGA(Altera,Xilinx,Lattice)
- 并口的CPLD烧录线，通过跳线支持三大厂家(Altera,Xilinx,Lattice)的CPLD/FPGA烧录,附有电路图与Verilog HDL文档.使用的芯片为XC9572XL-VQ64
Xilinx 和Altera FPGA 调试过程
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altera sdram controller
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“Altera杯”第五届全国研究生电子设计竞赛样板
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altera signalTap逻辑分析仪
- Altera.FPGA入门及提高教程]SignalTap.II.逻辑分析
Altera IP Core
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