[VHDL编程] ad0809verilog

说明：这是用Verilog编写的ad0809，和之前的vhdl功能相似，不过开发环境部一样-It is written in Verilog ad0809, and before the vhdl function similar, but the Ministry of Environment as the development
<潘牧野> 在 2025-06-19 上传 | 大小：1kb | 下载：0

[VHDL编程] cnt10

说明：用Quartus II开发的一个十进制计数器，包括仿真波形，下载文件，是完整工程。-With the Quartus II development of a decimal counter, including the simulation waveform, download files, is the complete project.
<鲁才> 在 2025-06-19 上传 | 大小：145kb | 下载：0

[VHDL编程] f_subber

说明：用Quartus开发的全减器设计，用原理图实现的。-By using Quartus development of the whole design, implemented using schematics.
<鲁才> 在 2025-06-19 上传 | 大小：70kb | 下载：0

[VHDL编程] sin_gnt

说明：用Quartus开发的基于DDS的一个正弦波信号发生器。-Quartus development with a DDS-based sine wave signal generator.
<鲁才> 在 2025-06-19 上传 | 大小：231kb | 下载：0

[VHDL编程] count

说明：1．用VHDL设计具有清除端、使能端，计数范围为0~999的计数器，输出为8421BCD码； 2．用VHDL设计十进制计数器（BCD_CNT）模块、七段显示译码器电路（BEC_LED）模块和分时总线切换电路（SCAN）模块。 3．用MAX+plusⅡ进行时序仿真。 -1. VHDL design with a clear end to end so that the count range of 0 to 999 in the counter, the output is 8421B
<小白> 在 2025-06-19 上传 | 大小：204kb | 下载：0

[VHDL编程] text

说明： 序列检测器可用于检测一组或多组由二进制码组成的脉冲序列信号。本系统用状态机来实现序列（1110010）的序列检测器的设计，若系统检测到串行序列 1110010 则输出为 1 ,否则输出为 0 ，并对其进行波形和功能仿真。-Sequence detection can be used to detect one or more groups formed by the binary code pulse train signal. The system implemented by the st
<小白> 在 2025-06-19 上传 | 大小：78kb | 下载：0

[VHDL编程] FPGA-quartus-tutorial

说明：vhdl教程，内部资料，结合具体的FPGA芯片CLCLONE 2 EP2C20Q240C8-vhdl tutorial, internal data, combined with the specific FPGA chip CLCLONE 2 EP2C20Q240C8
<刘> 在 2025-06-19 上传 | 大小：1.27mb | 下载：0

[VHDL编程] cf_fft_1024_8

说明：1024点的fft算法verilog实现程序，主要是通过verilog来实现fft算法- 1024 spot fft algorithm verilog realizes the procedure
<ALEX> 在 2025-06-19 上传 | 大小：11kb | 下载：0

[VHDL编程] suocunqi

说明：锁存器机及其激励内容包含锁存器程序及其激励程序朗朗上口-latch and it s jili prosursor，very good simulation,useful ziliao
<李刚> 在 2025-06-19 上传 | 大小：1kb | 下载：0

[VHDL编程] hhh

说明：实现基于液晶显示屏字幕图形的自动显示，而且很好的控制了fpga运行过程中时序的控制-LCD-based subtitles automatically display graphics, and good control of the fpga timing control during the operation
<闫志勇> 在 2025-06-19 上传 | 大小：212kb | 下载：0

[VHDL编程] CNT4

说明：好的4位计数器代码，大家需要可以下载，谢谢了。-4-bit counter is a good code, you need to download, thank you.
<小刚> 在 2025-06-19 上传 | 大小：155kb | 下载：0

[VHDL编程] verilog-eg

说明：适用于初学者的很好用的代码，里面有很多例子。大家可以参考学习-For beginners
<andy> 在 2025-06-19 上传 | 大小：27kb | 下载：0