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[VHDL编程] DDS_FINAL
说明:My project is on Direct Digital Synthesiser using Verilog HDL.This project is doing by me on july 2009 in summer training at NIT Kurukshetra, India. This DDS system generate the square wave, Triangular wave,Sine wave and saw wave with different fre<Raju Kumar> 在 2025-06-21 上传 | 大小:427kb | 下载:0
[VHDL编程] 61EDA
说明:分析了各种视频采集方案的研究现状。对如何采用CCD 摄像头采集高分辨率、高质量的图像以及基于FPGA 的嵌 入式视频图像采集系统的实现方法进行了研究。采用了以摄像头+ 解码芯片模式为采集方案, 针对视频解码芯片 ADV7181B,实现了I2C 总线配置、ITU656 解码、VGA 显示模块的设计。设计的视频采集控制器已经在Altera 公司的CycloneII 系列FPGA(EP2C35)上实现。结果显示本设计具有速度高、成本低、易于集成等优点-Analysis of a varie<李明> 在 2025-06-21 上传 | 大小:175kb | 下载:0
[VHDL编程] spasion_flash_verilog_model
说明:verilog模型,用于仿真flash,可以快速地看懂-verilog model for flash controller specified for spasion flash, please download it look at it<jiangwen> 在 2025-06-21 上传 | 大小:221kb | 下载:0