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[VHDL编程] example1
说明:本例程属于独立实验,主要是让大家熟悉一下VHDL 语言基本语法,这是比较简单的 程序了。实现一个将时钟信号clk 十分频的功能,可以通过波形仿真来看效果。 波形仿真的过程可以参考视频“波形仿真.exe”文件,有比较详细的操作方法。其实 在例程的项目中已经包含了波形仿真文件,大家可以直接仿真,观察结果。 -This routine is an independent experiment is designed to allow you familiarize yourself<汤化锋> 在 2025-12-25 上传 | 大小:23kb | 下载:0
[VHDL编程] bomakaiguan
说明:拨码开关程序,用Verilog语言编写,程序经测试完全没有问题。-DIP-switch procedure, with the Verilog language, the program has been tested and no problem.<韩瑞> 在 2025-12-25 上传 | 大小:42kb | 下载:0