资源列表

« 1 2 ... .94 .95 .96 .97 .98 2999.00 .01 .02 .03 .04 ... 4310 »

[VHDL编程1602

说明:VHDL实现的1602液晶显示程序,已调试成功-VHDL realization of 1602 liquid crystal display program, already debugging success
<> 在 2025-12-29 上传 | 大小:213kb | 下载:0

[VHDL编程RS232

说明:VHDL实现的RS232通信程序,发送和接收都已实现-VHDL realization of RS232 communication procedures, send and receive are realized
<> 在 2025-12-29 上传 | 大小:196kb | 下载:0

[VHDL编程Prentice---Verilog.HDL_A.Guide.to.Digital.Design.

说明:Written for both experienced and new users, this book gives you broad coverage of Verilog HDL. The book stresses the practical design and verification perspective ofVerilog rather than emphasizing only the language aspects. The informationpresented i
<bom> 在 2025-12-29 上传 | 大小:1.64mb | 下载:0

[VHDL编程SHA_1_V

说明:基于FIPS 180-4标准的SHA-1算法的verilog HDL实现-FIPS 180-4 standard SHA-1 algorithm-based verilog HDL implementation
<pppp> 在 2025-12-29 上传 | 大小:3kb | 下载:0

[VHDL编程SHA-256

说明:基于FIPS 180-4标准的SHA-256算法的verilog HDL实现-SHA-256 algorithm based on FIPS 180-4 standard verilog HDL implementation
<pppp> 在 2025-12-29 上传 | 大小:4kb | 下载:0

[VHDL编程softdrink_testbench

说明:一种可应用于自动售货机的状态机的verilog HDL描述-Verilog HDL descr iption of a state machine used in vending machines
<pppp> 在 2025-12-29 上传 | 大小:1kb | 下载:0

[VHDL编程sha1_v01

说明:基于FIPS 180-4标准的SHA-1算法的verilog HDL实现,分模块分别实现-FIPS 180-4 standard SHA-1 algorithm-based verilog HDL sub-modules, respectively, to achieve
<pppp> 在 2025-12-29 上传 | 大小:6kb | 下载:0

[VHDL编程quartus-clock.RAR

说明:设计FPGA电路以模拟多功能电子表的工作过程,功能如下:(1 )数字钟,要求从00:00 :00点计到23 :59:59 (2)数字跑表(3 )调整时间 (4)闹钟设置,可以设置2个闹钟,闹钟时间到了后会提醒,提醒时间持续20 秒,如果此时按A键,则该闹钟解除提醒,如果按住B键,闹钟暂停提醒。但是3 分钟后重复提醒一次。如果闹钟响时没有按键,则响完20秒之后暂停,然后同样3 分钟后重新提醒一次。(5 )日期设置。可以设置当前的日期, 比如2012年08月20 日。-Design FPGA c
<章梓音> 在 2025-12-29 上传 | 大小:1.59mb | 下载:0

[VHDL编程arm

说明:ARM内核的源代码描述,通过的各种仿真器的仿真,是学习嵌入式的好的列子,可以实现各种基本设计-ARM core
<阿汤哥> 在 2025-12-29 上传 | 大小:8kb | 下载:0

[VHDL编程serial-to-parallel

说明:学习串并转换的代码编写,认识编写风格和技巧,fpga官方网站的代码设计,可直接使用,通过了仿真-Learning string and converts the code written to recognize the writing style and skills, fpga official website of the code design, can be used directly, through simulation
<阿汤哥> 在 2025-12-29 上传 | 大小:1kb | 下载:0

[VHDL编程uart

说明:一个简单的串口描述文件,可以实现基本的串口功能-A simple serial port descr iption file, you can achieve the basic function of serial
<阿汤哥> 在 2025-12-29 上传 | 大小:1kb | 下载:0

[VHDL编程UART16550(Verilog)

说明:通过各项仿真的模块代码,是一个标准的模块,可以直接使用-Through various simulation module code is a standard module, can be used directly
<阿汤哥> 在 2025-12-29 上传 | 大小:11kb | 下载:0
« 1 2 ... .94 .95 .96 .97 .98 2999.00 .01 .02 .03 .04 ... 4310 »

源码中国 www.ymcn.org