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[VHDL编程] multiplyingunit
说明:其乘法器原理是:乘法通过逐项移位相加原理来实现,从被乘数的最低位开始,若为1,则乘数左移后与上一次的和相加;若为0,左移后以全零相加,直至被乘数的最高位-Its multiplier principle is: the sum of multiplication through each shift principle to achieve, from the lowest bit multiplicand to start, if 1, then the multiplier on the l<张华> 在 2025-06-19 上传 | 大小:134kb | 下载:0
[VHDL编程] FPGAshixianxiangweichuli
说明:有PFGA实现相位的测量,解决一些电路问题-Implementation phase has PFGA measurement circuit to solve some problem<谢名伟> 在 2025-06-19 上传 | 大小:134kb | 下载:0
[VHDL编程] first
说明:verilog 初学者原代码,万事开头难,CPLD也如此,第一个成功的代码测试往往后续学习的信心。需要的朋友请进-beginners verilog source code, everything is hard in the beginning, CPLD is also the case, the first successful test of the code is often the confidence of the follow-up study. Come friend in n<keny> 在 2025-06-19 上传 | 大小:134kb | 下载:0
[VHDL编程] jiaotongdeng
说明:关于交通灯的VERILOG程序设计,基于FPGA的交通等硬件电路设计-BASED ON FPGA<熊淑芬> 在 2025-06-19 上传 | 大小:134kb | 下载:0
[VHDL编程] simpleFIFO
说明:FIFO的VHDL程序,硬件描述语言源码-FIFO process of VHDL hardware descr iption language source code< 陳皇仁> 在 2025-06-19 上传 | 大小:134kb | 下载:0
[VHDL编程] FPGAshumaguan
说明:基于FPGA设计的,可以实现数码管显示的程序-Based on FPGA design, the program of digital tube display can be realized<刘华> 在 2025-06-19 上传 | 大小:135kb | 下载:0
[VHDL编程] DE2_TV_New_v2
说明:DE2官方板子程序,ALTERA官方代码,cyclone ii EP2C35F672C6N代码(DE2 official board procedures)<蜂蜜柚子 > 在 2025-06-19 上传 | 大小:135kb | 下载:0