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[VHDL编程] IP_adder-8bit
说明:IP core of adder,8-bit width, three design concerpts with different effect.-IP core of adder ,8-bit width, three design concerpts with different effect.<bulbul1225> 在 2025-06-14 上传 | 大小:2kb | 下载:0
[VHDL编程] count_free
说明:本程序是实现在用电话卡打电话时进行自动计费的功能,包括检测通话的种类,时间和余额检测等多项功能,此代码用veriloghdl编写已经调试通过编译。-Implementation of this procedure is used when the phone card to call the function of automatic billing, including the detection of the types of calls, time and number of functi<dengzhaoyun> 在 2025-06-14 上传 | 大小:2kb | 下载:0
[VHDL编程] Boothmultiplier
说明:布斯乘法器的语言描述功能违反外 暗暗达到-Booth multiplier described in the language<毛进> 在 2025-06-14 上传 | 大小:2kb | 下载:0
[VHDL编程] S3E_AnalogIO
说明:it is a analog i/o interface written in verilog .it will work on spartan 3 xilini devices.<ali> 在 2025-06-14 上传 | 大小:2kb | 下载:0
[VHDL编程] SF_table_interface
说明:switch fabric部分代码: fabric和table management 的数据交换. Mac address 从afifo输入, 查询的结果:output port number 存于pfifo中-switch fabric part of the code: fabric and table management data exchange. Mac address from afifo input, the results of inquiries: output port n<无影> 在 2025-06-14 上传 | 大小:2kb | 下载:0