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[VHDL编程mult32

说明:4-cycle 32bit-Multiplier that can be work in FPGA. Correct work is confirmed by SP605 FPGA from Xilinx.
<Masayuki Kimura> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程s_p2m_onechnl

说明:这是一个串转并的代码示例,将串行的数据转换为并行数据-This code example, a string transfer and the serial data is converted to parallel data
<李宁> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程p_s2m_onechnl

说明:这是一个并转串的代码示例,将并行的数据转换为串行数据-This is one and transferred to the string code example, the parallel data is converted into serial data
<李宁> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程lcd

说明:这是一个用verilog写的LED的控制代码,其中主要是利用状态机的形式实现的-This is a verilog the write LED control code, which is realized in the form of state machine
<李宁> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程SEG

说明:采用DE2 实现数码管递增 VERILOG-Using DE2 achieve the digital pipe incremental VERILOG
<金纯> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程data_gen

说明:产生随机的prbs序列。用于receiver的测试。误码率的测试等待-Generates random prbs sequence. For receiver testing. BER test wait
<lexie> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程prbs

说明:verilog 格式的prbs数据。可以用于对发射机和接收机的误码率的测试-verilog format prbs data. Can be used for the testing of the transmitter and receiver BER
<lexie> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程myfir

说明:verilog编写的16阶升余弦滤波器 采用直接型结构实现 对方波进行滤波 输出波形 含testbench文件-order raised cosine filter verilog written 16 direct-type structure to achieve the other wave filtering the output waveform containing testbench file
<yangyang> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程ps_transfer

说明:verilog HDL语言编写的8位并串转换,使用状态机实现可综合-Using verilog HDL language realize parallel-to-serial conversion, using the state machine to achieve ,can comprehense
<hedy> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程mux2to1

说明:2路选择器 很好很使用的VHDL语言 能够快速的解决问题-2-way selector
<陈梦飞> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程add8

说明:利用VHDL实现8位数据加法,完成方法为实验原理图直接搭建。-VHDL 8-bit data addition, the completion method for experimental schematic structures directly.
<李帅> 在 2025-06-02 上传 | 大小:1kb | 下载:0

[VHDL编程ft2232h_rollback

说明:FT2232H芯片usb循环读写 verilog 实现, 使用时pll可注释掉-FT2232H the chips usb cycle read and write verilog achieve
<123> 在 2025-06-02 上传 | 大小:1kb | 下载:0
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