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Altera
- 利用Nios Ⅱ软核处理器,以Altera公司的UP3开发板为硬件平台,以Quartus II、Quartus ID为软件开发平台,设计一个电子钟,实现下列系统功能: (1)在液晶屏上显示时间、日期、状态提示; (2)利用4个按键对时间(时分秒)、日期(年月日)进行设置; (3)利用一个LED灯指示当前设置状态;-The use of soft-core processor, Nios Ⅱ to Altera s UP3
AlteraQuartusI7.2
- Altera Quartus Ii 7.2 实用指南-Altera Quartus Ii 7.2 实用??南
dds
- 实现dds功能,利用quartus软件, 子模块包括加法器,锁相环,date-rom 利用原图将各模块综合,利用ps2键盘控制频率及相位。-Dds realize functions, using Quartus software, sub-modules including the adder, phase-locked loop, date-rom image to the module using integrated,
quartusexample
- quartus一个完整的设计例子,从安装到实例完成,仿真等全过程,适合从0开始的初学者-Quartus a complete design examples, examples from installation to completion, the entire process of simulation, etc., suitable for the beginner to start from 0
Des2Sim
- 本文介绍了一个使用 VHDL 描述计数器的设计、综合、仿真的全过程,作为我这一段 时间自学 FPGA/CPLD 的总结,如果有什么不正确的地方,敬请各位不幸看到这篇文章的 大侠们指正,在此表示感谢。当然,这是一个非常简单的时序逻辑电路实例,主要是详细 描述了一些软件的使用方法。文章中涉及的软件有Synplicity 公司出品的Synplify Pro 7.7.1; Altera 公司出品的 Quartus II 4.2;
Crack_QII8.0
- quartus 8 的内存注册机,已经试验过,非常好用,完全破解。-quartus 8 Zhuceji memory has been tested, very easy to use, completely broken.
Crack
- quartus ii 7.1 7.0crack
Crack_QII72
- QUARTUS-7.2的破解软件,可以破解QUARTUS-7.2,能用到2034年。-The crack QUARTUS-7.2 software, can crack QUARTUS-7.2, can be used to in 2034.
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- QUARTUS 的配置及调试 flv的 -Quartus flv configuration and commissioning of the
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- vhdl的仿真 quartus 2的flv视频 -VHDL simulation of the flv video quartus 2
DS1307_LCD
- 通过IIC总线读写实时时钟DS1307,并把时、分、秒显示在12864液晶屏上,用的CycloneII EP2C8,Quartus环境-Through the IIC bus read and write real-time clock, DS1307, and the hours, minutes and seconds displayed on the LCD screen on the 12864, used CycloneII
matlab_quartus
- 可以方便地将matlab里的数据导入quartus中的波形仿真文件中,很有用-Matlab can easily import the data in waveform simulation Quartus document, very useful
Quartusguide_huawei_pdf[1]
- quartus中文全部说明 可以方便初学者使用 改软件-Quartus Chinese full descr iption can be easily changed to use software for beginners
stopwatch
- 秒表可计时,用VHDL编译的源代码,从0.1到60秒计时,解压后直接用Quartus打开project即可-Stopwatch timer can be used to compile the VHDL source code, from 0.1 to 60 seconds from time, after extracting the direct use of Quartus can open the project
200681556499797
- 曼彻斯特编解码 用vhdl编写的,经过quartus功能仿真测试过了的-Manchester codec prepared using VHDL, the Quartus functional simulation has been tested
paobiao
- 给出了数字跑表的源代码,设计了分频模块,实现了真实的时间计数,通过这个工程的训练,能更好的了解Quartus II数字电路开发的过程。-Digital stopwatch given the source code, design the sub-frequency module, the realization of the true count of time, through this project the training,
ALU
- vhdl代码 使用quartus编译 cpu中 alu的设计 可作为课程设计的参考 此为16的运算器-VHDL code using Quartus compiler cpu in alu design of curriculum design can be used as a reference for this for 16 computing device
TimeQuest_Basic
- Quartus里面的TimeQuartus资料-Quartus inside information TimeQuartus
CLOCK
- 文通过ALTERA公司的quartus II软件,用Verilog HDL语言完成多功能数字钟的设计。主要完成的功能为:计时功能,24小时制计时显示;通过七段数码管动态显示时间;校时设置功能,可分别设置时、分、秒;跑表的启动、停止 、保持显示和清除。-Through the ALTERA company quartus II software, using Verilog HDL language to complete the de