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[VHDL编程] Altera-SDRAM_controller-IP-CORE
说明:ALTRA官方提供的SDRAM的控制内核,VHDL和VERILOG版本都有,希望对大家有用-The ALTRA official SDRAM control kernel, VHDL and VERILOG version have the hope that useful<mr jiang> 在 2025-12-27 上传 | 大小:2.27mb | 下载:0
[VHDL编程] FPGA_HS2812_12864
说明:开发板源码FPGA DSP2812,适合二次开发和学习-FPGA DSP2812<郑渊博> 在 2025-12-27 上传 | 大小:305kb | 下载:0
[VHDL编程] play_bench
说明:用于对ACE JTAG Player设计的IP核文件进行测试和检验-Testing and inspection for the ACE JTAG Player IP core design files<于德洋> 在 2025-12-27 上传 | 大小:2kb | 下载:0