[VHDL编程] post_norm_fmul2

说明：Post_norm_fmul2 vhdl code
<farnaz> 在 2025-06-18 上传 | 大小：6kb | 下载：0

[VHDL编程] mulfp

说明：Mulfp for vhdl coddin-Mulfp for vhdl coddingg
<farnaz> 在 2025-06-18 上传 | 大小：11kb | 下载：0

[VHDL编程] FLOAT

说明：Floating point vhdl coding
<farnaz> 在 2025-06-18 上传 | 大小：2kb | 下载：0

[VHDL编程] fpu_arch

说明：Floating point architecture
<farnaz> 在 2025-06-18 上传 | 大小：5kb | 下载：0

[VHDL编程] khanom-heydari

说明：Floaaattiing poiiint for vhd-Floaaattiing poiiint for vhdlll
<farnaz> 在 2025-06-18 上传 | 大小：177kb | 下载：0

[VHDL编程] polyphaseFIR_1v0

说明：polyphase fir dilter
<arjun> 在 2025-06-18 上传 | 大小：37kb | 下载：0

[VHDL编程] reset_syn

说明：复位信号的处理，实现“异步清零，同步释放”的功能。-Reset signal processing, " asynchronous clear, synchronous release" function.
<小白> 在 2025-06-18 上传 | 大小：1kb | 下载：0

[VHDL编程] clk_div

说明：时钟分频功能模块，采用计数器后两位异或再移位的方式实现，节约资源。-Clock divider function module, after using two different counter or re-shift ways to save resources.
<小白> 在 2025-06-18 上传 | 大小：1kb | 下载：0

[VHDL编程] rs422_r

说明：此功能模块实现了422标准协议的单字节接收功能，采用了起始位＋8位数据位+奇校验+1停止位的方式，实现了串行输入并行输出的功能。-This function module implements the standard protocols 422 single-byte receive function, using the start bit+ 8 data bits odd parity+1+ stop bits, enabling a serial input parallel outpu
<小白> 在 2025-06-18 上传 | 大小：2kb | 下载：0

[VHDL编程] rs422_t

说明：此功能模块实现了422标准协议的单字节发送功能，采用了起始位＋8位数据位+奇校验+1停止位的方式，实现了并行输入串行输出的功能。-This function module implements the standard protocols 422 single-byte transmit function, the start bit+ 8 data bits odd parity+1+ stop bits, enabling a parallel input serial output.
<小白> 在 2025-06-18 上传 | 大小：2kb | 下载：0

[VHDL编程] rx_decode

说明：对串行接收数据进行解码的功能，通过状态机实现，属于链路层协议的实现。-Serial reception data decoding function, by state machine, belonging to implement link layer protocol.
<小白> 在 2025-06-18 上传 | 大小：2kb | 下载：0

[VHDL编程] cpu

说明：一份精简指令cpu源代码，用verilog编写，已经通过仿真验证，可以模块化移植。-This is a file of cpu code. The cpu is risc cpu. It is simulated and verificated.And the cpu can be transplanted as a module.
<耿瑞> 在 2025-06-18 上传 | 大小：7kb | 下载：0