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  1. leg_source

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  2. verilog hdl编写,六段流水线CPU.程序完整,功能强惊。分为多模块编写-verilog hdl prepared replace pipelined CPU. The integrity of the process, strong function scared. Divided into multiple modules prepared
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2024-05-21
    • 文件大小:656384
    • 提供者:lumingzhi
  1. redandyellow

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  2. 交通灯,十字路口红绿灯的VHDL程序,绝对可用-traffic lights, traffic lights crossroads VHDL procedures, absolutely available
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:49152
    • 提供者:
  1. chap5

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  2. 《Verilog HDL 程序设计教程》2-"Verilog HDL Design Guide," 2
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:5120
    • 提供者:hutian
  1. chap7

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  2. 《Verilog HDL 程序设计教程》4-"Verilog HDL Design Guide" 4
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:4096
    • 提供者:hutian
  1. chap8

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  2. 《Verilog HDL 程序设计教程》5-"Verilog HDL Design Guide" 5
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:4096
    • 提供者:hutian
  1. chap9

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  2. 《Verilog HDL 程序设计教程》6-"Verilog HDL Design Guide" 6
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:7168
    • 提供者:hutian
  1. chap10

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  2. 《Verilog HDL 程序设计教程》7-"Verilog HDL Design Guide," 7
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:8192
    • 提供者:hutian
  1. chap11

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  2. 《Verilog HDL 程序设计教程》8-"Verilog HDL Design Guide" 8
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:5120
    • 提供者:hutian
  1. chap12

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  2. 《Verilog HDL 程序设计教程》9-"Verilog HDL Design Guide" 9
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:4096
    • 提供者:hutian
  1. 24bitdisplay

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  2. 一个VEILOG HDL程序,可以直接应用,-A VEILOG HDL procedures, can be applied directly,
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:104448
    • 提供者:张金辉
  1. lcd

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  2. 用FPGA来控制2*16LCD的程序,采用VHDL语言来编写,并且我把他转换为verilog语言,有意者请联系;
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:1024
    • 提供者:赵雯
  1. veriloguartrx

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  2. verilogHDL编写的串口检测程序,自己写的,相对其他的代码,本程序比较简短,初学者容易掌握。-verilogHDL prepared by serial testing procedures, their own writing, compared with other code, the procedure relatively brief, easy to grasp for beginners.
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:1024
    • 提供者:
  1. altera_ram

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  2. 本程序对如何使用altera系列芯片片上ram进行实例演示,采用Verilog HDL语言编写,并使用modelsim与quartus联合进行功能仿真。本原码是红色逻辑开发板的试验程序,值得一看。-This procedure of how to use the altera series chip-chip ram for example demonstration, using Verilog HDL language, and u
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:180224
    • 提供者:panyouyu
  1. uartverlog

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  2. 占用资源少的verilog HDL uart接口;采用固定波特率115200,可以修改程序中的分频来修改波特率,模式为1个启始位,8位数据位,1个停止位;带1字节缓存;当缓存空时输出空信号-Occupy fewer resources verilog HDL uart interface adopted a fixed baud rate of 115200, can modify the procedure to modify th
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:2048
    • 提供者:张诚
  1. viterbi

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  2. VHDL 程序,实现vertibe的编码和解码。-VHDL procedures vertibe realize the encoding and decoding.
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:2048
    • 提供者:左麟
  1. Veilogbook

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  2. 第一章 数字信号处理、计算、程序、算法和硬线逻辑的基本概念 第二章 Verilog HDL设计方法概述 第三章 Verilog HDL的基本语法 第四章 不同抽象级别的Verilog HDL模型 第五章 基本运算逻辑和它们的Verilog HDL模型 第六章 运算和数据流动控制逻辑 第七章 有限状态机和可综合风格的Verilog HDL-The first chapter of digital signal pr
  3. 所属分类:软件工程

    • 发布日期:2024-05-21
    • 文件大小:1079296
    • 提供者:碗筷
  1. digtalclk

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  2. 用Altera公司的QuartusII编写的电子钟程序,可以下载至开发板,实现一个智能数字钟功能,计时,校时,闹钟,跑表等功能,也可用于学习verilog HDL语言与数字逻辑-Using Altera s QuartusII procedures for the preparation of electronic bell, you can download to a development board, the realizatio
  3. 所属分类:家庭/个人应用

    • 发布日期:2024-05-21
    • 文件大小:2094080
    • 提供者:张欢
  1. AD7865test1

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  2. verilog hdl写的利用fpga控制ad7865进行多路ad数据采集的程序源代码。-err
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2024-05-21
    • 文件大小:309248
    • 提供者:nwpu2005
  1. LCD_Driver

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  2. LCD的驱动程序 用verilog HDL 编写 可以用于FPGA上 经过测试 可以使用-LCD driver with verilog HDL can be used for the preparation of the FPGA can be tested using
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2024-05-21
    • 文件大小:2048
    • 提供者:德刚
  1. jianpansaomiao__verilog

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  2. 一个veriloghdl编写的键盘扫描程序-Veriloghdl the preparation of a keyboard scanner
  3. 所属分类:VHDL编程

    • 发布日期:2024-05-21
    • 文件大小:734208
    • 提供者:zhangzhenqi
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