[VHDL编程] count

说明：用verilog语言编写一个计数器，改参数实现不同时间的计数器(Writing a counter in the Verilog language)
<sagee> 在 2025-06-06 上传 | 大小：381kb | 下载：0

[VHDL编程] LS164

说明：用verilog原因实现LS164移位寄存器(Implementation of the LS164 shift register with Verilog)
<sagee> 在 2025-06-06 上传 | 大小：354kb | 下载：0

[VHDL编程] FPGA8 shuma

说明：用四位数管显示八位数字并且向左滚动播放。(Four digit tubes display eight digit numbers and roll playback)
<sagee> 在 2025-06-06 上传 | 大小：763kb | 下载：0

[VHDL编程] vc2015_x64_14.0.24215

说明：windows 7 安装VIVADO 需要(Microsoft Visual C++ 2015 Redistributable(x64) - 14.0.24215)
<不名存在> 在 2025-06-06 上传 | 大小：12.93mb | 下载：0

[VHDL编程] _uart_test2

说明：data transmitted from FPGA to PC using COM PORT version 2
<anh92> 在 2025-06-06 上传 | 大小：8kb | 下载：0

[VHDL编程] _spi_test1

说明：data transmitted from FPGA to devices using SPI bus
<anh92> 在 2025-06-06 上传 | 大小：7.69mb | 下载：0

[VHDL编程] add.v

说明：这是verilog的加法器。它可用于超大规模集成电路设计。(This is an adder by Verilog. It can be used for VLSI design.)
<limiduo> 在 2025-06-06 上传 | 大小：1kb | 下载：0

[VHDL编程] sdram_ov7670_vga

说明：利用FPGA采集图像，实现系统检测，很好的采集图像的源代码(Image acquisition using FPGA)
<让我娘家看> 在 2025-06-06 上传 | 大小：5.18mb | 下载：0

[VHDL编程] Verilog的边沿检测技术_设计源代码

说明：波形数据上升下降沿的检测程序，已经经过仿真验证(The detection program of the rising descending edge of the waveform data has been verified by simulation)
<gxgone> 在 2025-06-06 上传 | 大小：36kb | 下载：0

[VHDL编程] dpll

说明：数字全锁相环的介绍文章，讲述了数字锁相环的实现原理和实现步骤(The introduction of the digital full phase locked loop is introduced, and the realization principle and the implementation steps of the digital phase locked loop are described)
<CrazyICer> 在 2025-06-06 上传 | 大小：188kb | 下载：0

[VHDL编程] xapp1052

说明：赛灵思官方pcie例程，官网下载需要注册登录，这边给大家另一个选择(Xilinx PCIe official routines, the official website to download the required registration login, here give you another choice)
<gxgone> 在 2025-06-06 上传 | 大小：2.75mb | 下载：0

[VHDL编程] i2c_master_ip_for_nios

说明：i2c master ip for altera nios, add in qsys
<kevinfeng83> 在 2025-06-06 上传 | 大小：213kb | 下载：0